DDR2+SDRAM控制器的FPGA实现

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江南大学学报!自然科学版"第!卷第"期&’()!!*’)"

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须文波.#!胡!丹

!江苏无锡"北京.$.)江南大学信息工程学院".%.""#")中国科学院计算技术研究所"###B#摘!要!龙芯C"中集成的是C但鉴于C’D第一版本!EDF32"GH+I控制器#GH+I性能的限制#"使其成为提高龙芯C为了进一步提高龙芯C在新一款中集成了G’D性能的瓶颈)’D性能#GH"控制器)因为G使其实现相对于C因此预先在JGH"采用了新技术#GH+I更为复杂#KL+上对其进行实现#以方便对其在整个C目前#该控制器已经通过功能仿真#并在M’D设计中的集成)6(6A7公司的&6-<>7%系列JKL+上得以实现)"

关键词!龙芯C’D#现场可编程逻辑门阵列#第二代GGH同步动态内存中图分类号!FK"/2)!$F*%

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GH"是由]3G3D定义全新的下一代GGH内!!G

存技术标准%是GGH内存的换代产品)GGH"内存相比G更高的密GH内存将拥有更少的能耗和发热量%它的数据传输达到了%现已度和频率)##IQV以上%可支持%%%其标准工作频##!22$$/IQV的传输率%率分别是"%%%它的工作电压为.##"$$222IQV)B

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使用J&%XL+封装.)文中介绍了G给GH"的内存特点与工作原理%

出了一个用&>-6(’^语言设计的GGH"TQG

并在MCGH+I控制器%6(6A7公司的&6-<>7%系列"JKL+上得到了实现)

H!GGH"CGH+I的特点及控制信号

HIH!99:;)9:<=的特点

采用了在时钟的上GGH"内存技术和GGH一样%升沿和下降沿同时进行数据传输的基本方式)但是它

"##%0."0#1""##!0#.0.2)!!收稿日期!!修订日期!

%男%江苏无锡人%教授%博士生导师)主要从事计算机系统结构等研究).1%$0$!!作者简介!须文波#

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