D触发器工作原理
主从JK触发器是在CP脉冲高电平期间接收信号,如果在CP高电平期间输入端出现干扰信号,那么就有可能使触发器产生与逻辑功能表不符合的错误状态。
D触发器工作原理
D触发器工作原理
主从JK触发器是在CP脉冲高电平期间接收信号，如果在CP高电平期间输入端出现干扰信号，那么就有可能使触发器产生与逻辑功能表不符合的错误状态。边沿触发器的电路结构可使触发器在CP脉冲有效触发沿到来前一瞬间接收信号，在有效触发沿到来后产生状态转换，这种电路结构的触发器大大提高了抗干扰能力和电路工作的可靠性。下面以维持阻塞D触发器为例介绍边沿触发器的工作原理。
维持阻塞式边沿D触发器的逻辑图和逻辑符号如图9-7所示。该触发器由六个与非门组成，其中G1、G2构成基本RS触发器，G3、G4组成时钟控制电路，G5、G6组成数据输入电路。和
分别是直接置0和直接置1端，有效电平为低电平。分析工作原理时，设
和
均为高电平，不影响电路的工作。电路工作过程如下。
(a) (b) 逻辑符号
逻
辑
图
图9-7 维持阻塞型D触发器
① CP=0时，与非门G3和G4封锁，其输出为1，触发器的状态不变。同时，由于G5和=
。
和
的状态由G5和G6的输出状态
。
至G6的反馈信号将这两个门G5、G6打开，因此可接收输入信号
，使
=
，=
至
② 当CP由0变1时，门G3和G4打开，它们的输出决定。
=
=
，
=
=
。由基本RS触发器的逻辑功能可知，=
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