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RS触发器与集成触发器

数字电路与逻辑设计基础实验 —RS触发器与集成触发器

(一) 实验目的

（1）、在理论知识的基础上，继续深入掌握触发器的逻辑功能及其测试方法 （2）、学习和熟悉基本Rs触发器，集成D触发器，JK触发器逻辑功能

（二） 实验器材

（1）直流稳压电源、数字逻辑电路实验箱、万用表 （2）数字逻辑电路元件74LS02、74LS74、74LS76

（三） 实验内容

（１）、用74LS02构成一个基本或非门RS触发器，并分析在输入端RS各种取值情况下，输出端Q，Q的值，整理结果，形成真值表，并比较或非门和与非门构成的基本RS触发器的逻辑功能。

（２）、用74LS74实现D触发器，分析在输入端D各种取值情况下，当上升沿到来时，输出端Q，Q的值，整理结果，形成真值表

（3）用74LS76构成ＪＫ触发器，分析在JK输入端，时钟脉冲输入端ＣＰ不同输入状态情况下，输出端Ｑ，Q的值，形成真值表，并分析逻辑功能

（四） 实验原理

触发器是一种具有记忆功能，可以存储二进制信息的双稳态电路，它是组成时序逻辑电路的基本单元，也是最基本的时序电路。Ｑ基本ＲＳ触发器：其特征方程为：Ｑ

n 1

为触发器的下一个输出状态

n 1

＝S＋ＲＱ约束条件为Ｓ＋Ｒ＝１；

Ｄ触发器：也叫数据锁存器，当时钟脉冲信号ＣＰ＝０时，触发器保持原状态不变，当ＣＰ＝１时，Ｑ

n 1

＝Ｄ，即输出只和输入状态Ｄ有关。

JK触发器：当时钟脉冲信号ＣＰ＝０时，触发器保持原状态不变；当CP=1时，其特征方程为：Ｑ

n 1

=JQ+KQ，即当J=K=T是ＪＫ触发器相当于Ｔ触发器，Ｊ＝Ｋ＝１时，相当于Ｔ’

触发器。

（五）实验步骤

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